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飞利浦员工笔试

发布时间2011-8-15

试题及答案:

1用逻辑门和 cmos 电路实现 ab cd
2用一个二选一 mux 和一个 inv 实现异或
3给了 reg 的 setup 和 hold 时间求中间组合逻辑的 delay 范围
4如何解决亚稳态
5用 Verilog/VHDL 写一个 fifo 控制器
6用 Verilog/VDDL 检测 stream 中的特定字

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飞利浦员工笔试

发布时间2011-8-15

试题及答案:

不知道是否所有职位都做相同的 on-line test这里和大家分享一下我的网上测试吧希望对准备做测试的同学们有所帮助最近逐渐体会到了找工作的艰辛大家都不容易一起加油努力吧
1首先最好能在网络条件计算机条件较好较稳定且环境比较安静不要分散注意力的地方准?#38468;?#34892;测试因为测试是限时的而且时间比较紧一旦进入测试环节倒计时就开始了要全力以赴答题才可能完成注网速不影响时间SHL 将测试传到本地机做完后上传所以计算机不死机网络不断网就行了
2登录 SHL 后先简要填写个人信息比如国籍等英文也有法语德语或其他语种可选无中?#30446;?#36873;
[全文]

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飞利浦员工笔试

发布时间2011-8-15

试题及答案:

刚做完 SHL两个?#20339;?#20013;文都提前答完
Verbal 肯定是英语水平好的?#25226;?#33521;文好因为中文容易误解题意不过英文的 verbal 我还是有点怕只有选中文用英文的感觉来读选英文的话难度跟 KPMG 的 verbal 相同也就是 SHL 试做的水平
Numerical 是跟瑞银相同的题目因为之?#21543;?UBS 载过论坛的一套题做过了加上申的过程等于做了两遍这种 numerical 的题目难度是比 SHL 试做的水平也就是 KPMG 笔试的难度低一个档次的相信大家去载 UBS 的题源看两遍都能做好加上做飞利浦的题目可以选中文我提前了差不多 7 分钟交卷?#35805;?#27861;又不能[全文]

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飞利浦员工笔试

发布时间2011-5-14

试题及答案:

1用逻辑们和cmos电路实现ab cd
2. 用一个二选一mux和一个inv实现异或
3. 给了reg的setup,hold时间求中间组合逻辑的delay范围 Setup/hold time 是测试芯片对输入信号和时?#26377;?#21495;之间的时间要求建立时间是指触发器的时?#26377;?#21495;上升沿到来以前数据稳定不变的时间输入信号应提前时钟上升沿如上升沿有效T时间到达芯片这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器只有在下一个时钟上升沿数据才能被打入触发器 保持时间是指触发器的时?#26377;?#21495;上升沿到来以后数据稳定不变的时间时hold [全文]

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